由于 Quartus® Prime 标准版软件版本 19.1 存在一个问题,您在编译的合成阶段可能会看到此错误。使用 Synplify Pro* FPGA 合成软件进行合成时会发生此内部错误。
要解决此问题,请使用以下分配:
set_global_assignment名称DISABLE_LEGACY_TIMING_ANALYZER开启
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