文章 ID: 000076418 内容类型: 故障排除 上次审核日期: 2020 年 12 月 08 日

为什么多个 IP 设计示例在 Agilex™ 7 FPGA 系列收发器 SoC 开发套件上失败?

环境

    英特尔® Quartus® Prime Pro Edition
    SerialLite
    以太网
    英特尔® CPRI
    Interlaken(第二代)英特尔® FPGA IP
    JESD204B 英特尔® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT

关键问题

说明

以下 IP 内核生成了 VID 设置不正确的 Agilex™ 7 FPGA 系列收发器 SoC 开发套件的示例设计。

1) Serial Lite IV IP

2) Interlaken(第二代)IP

3) 三速以太网 IP

4) E-Tile 动态重构 IP

5) 面向以太网和 CPRI PHY IP 的 E-Tile 硬 IP

6) JESD204B IP

7) JESD204C IP

8) 以太网子系统 IP

解决方法

正确的 VID 设置可在 Agilex™ F 系列收发器 SoC 开发套件用户指南 的第 6.1 节 “添加 SmartVID 设置®” 中找到。

使用正确的 VID 设置更新设计示例,如下所示:

set_global_assignment名称PWRMGT_BUS_SPEED_MODE“100 KHZ”
set_global_assignment - 名称 PWRMGT_SLAVE_DEVICE0_ADDRESS 42
set_global_assignment名称 PWRMGT_SLAVE_DEVICE1_ADDRESS 00
set_global_assignment名称 PWRMGT_SLAVE_DEVICE2_ADDRESS 00
set_global_assignment名称 PWRMGT_SLAVE_DEVICE3_ADDRESS 00
set_global_assignment名称 PWRMGT_SLAVE_DEVICE4_ADDRESS 00
set_global_assignment名称 PWRMGT_SLAVE_DEVICE5_ADDRESS 00
set_global_assignment名称 PWRMGT_SLAVE_DEVICE6_ADDRESS 00
set_global_assignment名称 PWRMGT_SLAVE_DEVICE7_ADDRESS 00

set_global_assignment名称USE_PWRMGT_SCL SDM_IO0
set_global_assignment名称USE_PWRMGT_SDA SDM_IO12
set_global_assignment名称USE_CONF_DONE SDM_IO16
set_global_assignment - 名称VID_OPERATION_MODE“PMBUS MASTER”

set_global_assignment名称PWRMGT_VOLTAGE_OUTPUT_FORMAT“线性格式”
set_global_assignment名称PWRMGT_LINEAR_FORMAT_N“-13”
set_global_assignment -名称 PWRMGT_TRANSLATED_VOLTAGE_VALUE_UNIT 伏特

此问题计划在 英特尔® Quartus® Prime 专业版软件的未来版本中修复。

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英特尔® Agilex™ F 系列 FPGA 和 SoC FPGA

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