面向以太网的英特尔® FPGA IP - 支持中心

欢迎访问面向以太网的英特尔® FPGA 知识产权 (IP) 支持中心!

在这里,您可以了解到有关如何选择、设计和实施以太网链路的信息。同时,您还将获得关于如何创建系统和调试以太网链路的指南。本页面按类别编写,与太网系统的完整设计流程相吻合。  

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参考表 1 了解面向英特尔® Stratix® 10 和英特尔® Arria® 10 设备的以太网知识产权 (IP) 内核支持。比较两种设备,为您的以太网子系统实施选择合适的设备。

表 1 - 设备与 IP 核支持
设备产品家族 Tile 类型(仅英特尔®  Agilex® 设备)  IP 核 电气接口 前向纠错 1588精密时间协议 自动协商/ 链路调训
英特尔® Agilex® E-Tile 

面向以太网英特尔 FPGA IP 的 E-Tile 硬 IP 用户指南(HTML | PDF)

面向以太网英特尔 Agilex FPGA IP 的 E-Tile 硬 IP 设计示例用户指南

(HTML | PDF

100GBASE-KR4 100GBASE-CR4

CAUI-4 CAUI-2

25GBASE-KR 25GBASE-CR

25GBASE-R AUI 

25GBASE-R Consortium Link

10GBASE-KR 10GBASE-CR

 

 

 

Reed Solomon (528, 514)

Reed Solomon (544, 514)

check mark check mark
设备产品家族 Tile 类型(仅英特尔®  Stratix® 10 device 设备)  IP 核 电气接口 前向纠错 1588精密时间协议 自动协商/ 链路调训
英特尔® Stratix® 10 GX/SX/MX/TX/DX L-Tile 和 H-Tile  三速以太网英特尔® FPGA IP
查看 IP 核用户指南  (HTML | PDF)
10BASE-T 100BASET 1000BASE-T 1000BASE-X   check mark check mark
L-Tile 和 H-Tile  低延迟以太网 10G MAC 英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
查看设计示例用户指南 (HTML | PDF)
10BASE-T 100BASET 1000BASE-T 1000BASE-X 10GBASE-R NBASE-T MGBASE-T 法尔码FEC check mark check mark
L-Tile 和 H-Tile  10GBASE-R 英特尔 FPGA IP
查看面向 L- 和 H-tile 的 IP 核用户指南 (HTML | PDF)
L-Tile 和 H-Tile  10GBASE-KR PHY 英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
L-Tile 和 H-Tile  1G/2.5G/5G/10G 多速率以太网 PHY 英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
L-Tile 和 H-Tile  低延迟 40-Gbps 以太网英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
查看设计示例用户指南 (HTML | PDF)
40G-BASE-R4 法尔码FEC   check mark
H-Tile 

面向以太网的英特尔® FPGA H-Tile 硬 IP

查看 IP 核用户指南 (HTML | PDF)

查看设计示例用户指南 (HTML | PDF)

50G-BASE-R2

100G-BASE-R4

    check mark
L-Tile 和 H-Tile

25Gbps 以太网英特尔Stratix 10 FPGA IP

查看 IP 核用户指南 (HTML | PDF)

查看设计示例用户指南 (HTML | PDF)

25GBASE-SR

10GBASE-R

Reed Solomon (528, 514) check mark  
L-Tile 和 H-Tile  低延迟 100-Gbps 以太网英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
查看设计示例用户指南 (HTML | PDF)
100G-BASE-R4 Reed Solomon (528, 514)    
E-Tile 

面向以太网英特尔 FPGA IP 的 E-Tile 硬 IP 用户指南 (HTML | PDF)

面向以太网英特尔 Stratix 10 FPGA IP 的 E-Tile 硬 IP 设计示例用户指南

(HTML | PDF

100GBASE-KR4 100GBASE-CR4

CAUI-4 CAUI-2

25GBASE-KR 25GBASE-CR

25GBASE-R AUI 

25GBASE-R Consortium Link

10GBASE-KR 10GBASE-CR

 

 

 

Reed Solomon (528, 514)

Reed Solomon (544, 514)

check mark check mark
设备产品家族 IP 核 电气接口 前向纠错 1588精密时间协议 自动协商/ 链路调训
英特尔® Arria® 10 GX/GT/SX 三速以太网英特尔 FPGA IP
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10BASE-T 100BASET 1000BASE-T 1000BASE-X   check mark check mark
低延迟以太网 10G MAC 英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
查看设计示例用户指南 (HTML | PDF)
10BASE-T 100BASET 1000BASE-T 1000BASE-X 10GBASE-R NBASE-T MGBASE-T 法尔码FEC check mark check mark
10GBASE-R 英特尔 FPGA IP
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XAUI PHY 英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
1G/10GbE 和 10GBASE-KR PHY 英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
1G/2.5G/5G/10G 多速率以太网 PHY 英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)


低延迟 40 Gbps 以太网英特尔 FPGA IP
查看 IP 核用户指南
(HTML | PDF)

查看设计示例用户指南(HTML | PDF)

40G-BASE-R4 法尔码FEC check mark check mark
低延迟 100 Gbps 以太网英特尔 FPGA IP
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查看设计示例用户指南 (HTML | PDF)
100G-BASE-R10 100G-BASE-R4 Reed Solomon (528, 514) check mark  
25 Gbps 以太网英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
查看设计示例用户指南 (HTML | PDF)
25G-BASE-R1 Reed Solomon (528, 514) check mark  
50 Gbps 以太网英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
查看设计示例用户指南 (HTML | PDF)
50G-BASE-R2      
设备产品家族 IP 核 电气接口 前向纠错 1588精密时间协议 自动协商/ 链路调训
英特尔® Cyclone® 10 LP/GX 三速以太网英特尔 FPGA IP
查看 IP 核用户指南 (HTML | PDF)
10BASE-T 100BASET 1000BASE-T 1000BASE-X   check mark check mark

 

低延迟以太网 10G MAC 英特尔 FPGA IP

(仅英特尔 Cyclone® 10 GX only)
查看 IP 核用户指南 (HTML | PDF)

10GBASE-R   check mark  

请参考相应的用户指南,了解和检测上表列出的各种特性是否相互排斥。例如:面向低延迟 100 Gbps 以太网的英特尔® FPGA IP(面向英特尔® Arria® 10 设备)不支持您同时启用 RS-FEC 和 1588 PTP。

请参考您所选的 IP 核用户指南的入门部分。您也可以参考以下文档以了解详情:

英特尔® Arria® 10 设备

  • AN 735:Altera® 低延迟以太网 10G MAC IP 核迁移指南  (HTML | PDF)
  • AN 795:关于使用低延迟 10G MAC IP 核在 Arria® 10 设备中实施 10G 以太网子系统的指南  (HTML | PDF)
  • AN 808:从 Arria® 10 迁移到面向 10G 以太网子系统的 Stratix® 10 的指南  (HTML | PDF)

英特尔® Stratix® 10 设备

  • AN 778:英特尔® Stratix® 10 收发器使用指南  (HTML | PDF)

面向以太网的英特尔® FPGA IP

面向以太网的英特尔 FPGA IP 产品组合包含各种 IP 类型,支持从 10 Mbps 到 100 Gbps 的数据速率。以太网 IP 解决方案包括介质访问控制器和 PHY IP 核,后者包括物理介质附件 (PMA) 和物理编码子层 (PCS)。如欲了解更多信息,请参考以下用户指南:

 

英特尔® Agilex® 设备

  • 面向以太网英特尔 FPGA IP 的英特尔® E-Tile 硬 IP 用户指南 (HTML | PDF)
  • 英特尔® E-Tile 收发器 PHY 用户指南(HTML | PDF)
  • 英特尔® E-Tile 收发器 PHY 用户指南 下载

 

英特尔® Stratix® 10设备

  • 英特尔® FPGA 三速以太网 IP 核用户指南(HTML | PDF)
  • 英特尔® FPGA 低延迟以太网 10G MAC IP 核用户指南(HTML | PDF)
  • 英特尔® Stratix® 10 1G/2.5G/5G/10G 多速率以太网 PHY IP 核用户指南(HTML | PDF)
  • 英特尔® Stratix® 10 10GBASE-KR PHY IP 核用户指南(HTML | PDF)
  • 英特尔® Stratix® 10 低延迟 40-Gbps 以太网IP 核用户指南(HTML | PDF)
  • 英特尔® Stratix® 10 低延迟 100-Gbps 以太网IP 核用户指南(HTML | PDF)
  • 面向以太网英特尔® FPGA IP 的英特尔® Stratix® 10 E-tile 硬 IP 用户指南(HTML | PDF)
  • 英特尔® Stratix® 10 E-Tile 收发器PHY 用户指南(HTML | PDF)
  • 面向以太网英特尔® FPGA IP 的英特尔® Stratix® 10 H-tile 硬 IP 用户指南(HTML | PDF)
  • 英特尔® Stratix® 10 L-Tile 和 H-Tile 收发器 PHY 用户指南(HTML | PDF)
  • 英特尔® Stratix® 10 E-Tile 通道放置工具下载

 

英特尔® Arria® 10设备

  • 英特尔® FPGA 三速以太网 IP 核用户指南(HTML | PDF)
  • 英特尔® FPGA 低延迟以太网 10G MAC IP 核用户指南(HTML | PDF)
  • 25 Gbps 以太网IP 核用户指南(HTML | PDF)
  • 50 Gbps 以太网IP 核用户指南(HTML | PDF)
  • 低延迟 40 Gbps 以太网IP 核用户指南(HTML | PDF)
  • 低延迟 100 Gbps 以太网IP 核用户指南(HTML | PDF)
  • 低延迟 40- 和 100-Gbps 以太网MAC 和 PHY MegaCore 功能用户指南(HTML | PDF)

 

英特尔® Cyclone® 10设备

  • 英特尔® FPGA 三速以太网 IP 核用户指南(HTML | PDF)
  • 英特尔® FPGA 低延迟以太网 10G MAC IP 核用户指南(HTML | PDF
英特尔® Cyclone® 10 设备
  • 英特尔® Cyclone® 10 GX 设备产品家族引脚连接指南(HTML | PDF)
英特尔® Arria® 10 设备
  • 英特尔® Arria® 10 GX、GT 和 SX 设备产品家族引脚连接指南(HTML | PDF)
英特尔® Stratix® 10 设备
  • 英特尔® Stratix® 10 GX、MX、TX 和 SX 设备产品家族引脚连接指南(HTML | PDF)

英特尔® Agilex® 设备

  • 英特尔® Agilex® 设备家族引脚连接指南(HTML | PDF)

 

  • 主板布局测试
  • AN 114: 英特尔® 可编程设备封装主板设计指南(HTML | PDF)
  • AN 766: 英特尔® Stratix® 10 设备高速信号接口布局设计指南(HTML | PDF)
  • AN 613: 面向英特尔® FPGA 的 PCB 层叠设计注意事项(HTML | PDF)
  • AN 875: 英特尔 Stratix 10 E-Tile PCB 设计指南(HTML | PDF)
  • AN 886: 英特尔 Agilex 设备设计指南(HTML | PDF)
  • AN 787: 英特尔 Stratix 10 散热建模和管理 (HTML | PDF)
  • 面向英特尔® Arria® 10 和英特尔® Stratix® 10 设备的 AN 692 上电顺序注意事项  (HTML | PDF)
英特尔® Arria® 10 设备
英特尔® Stratix® 10 设备
  • 三速以太网
    • AN830: 英特尔 FPGA 三速以太网和板载 PHY 芯片参考设计 (HTML | PDF)
  • 1G/2.5G 以太网
  • 10G 以太网
    • 面向低延迟以太网 10G MAC 的英特尔® FPGA IP 设计示例用户指南 (HTML | PDF)
  • 40G 以太网
    • 面向低延迟 40-Gbps 以太网的英特尔® FPGA IP 设计示例用户指南 (HTML | PDF)
  • 面向以太网的英特尔® FPGA H-Tile 硬 IP
    • 设计示例用户指南 (HTML | PDF)
  • 100G 以太网
    • 面向低延迟 100-Gbps 以太网的英特尔® FPGA IP 设计示例用户指南 (HTML | PDF)
  • 面向英特尔 Stratix 10 的 E-tile 硬 IP
    • FPGA IP 设计示例用户指南 (HTML | PDF)
英特尔® Agilex® 设备
  • 面向以太网英特尔 Agilex 的 E-tile 硬 IP
    • FPGA IP 设计示例用户指南(HTML | PDF)
标题 说明
Altera® 1588 系统解决方案如何支持不同的时钟模式 了解全新的英特尔 1588 系统级参考设计,后者使用了面向 10G 以太网 MAC(具备 10G BaseR PHY)的英特尔 FPGA IP 和 PTP 堆栈 LinuxPTPv1.5、预加载程序、10 Gbps 以太网 MAC 驱动程序、PTP 驱动程序等软件。
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英特尔 2.5G 以太网 IP 观看 2.5G 以太网 IP 实战论坛视频

英特尔® Stratix® 10 设备以太网链路检查器

以太网链路检查器主要包含两个辅助工具:


1) 链路监控器 - 支持您持续监控英特尔 Stratix 10 设备与链路伙伴间以太网链路的运行状态。您可以监控的部分主要特性包括:链路状态汇总(CDR 锁定、RX 恢复频率、通道比对锁定等。) MAC 数据包统计,FEC 统计等。

2) 链路分析 - 支持您查看和了解链路启动顺序(比如自动协商、链路调训等)或 Signal Tap 逻辑分析器文件捕捉的其他事件。针对特定事件配置并捕捉 Signal Tap 逻辑分析器文件,然后使用链路分析导入捕捉的事件并研究该事件发生期间英特尔 Stratix 10 的行为。

 

如欲访问面向特定 Quartus 版本的以太网链路检查器,请参见下表。

  • 关于 IP 和设备支持使用模式,请参阅相关以太网链路检查器用户指南中的“1.2 支持的 IP 核与设备”一节。

英特尔® Cyclone® 10 设备

  • 英特尔® FPGA 三速以太网 IP 核发行说明  (HTML | PDF)
  • 英特尔® FPGA 低延迟以太网 10G MAC IP 核发行说明  (HTML | PDF)
英特尔® Arria® 10 设备
  • 英特尔® FPGA 三速以太网 IP 核发行说明  (HTML | PDF)
  • 英特尔® FPGA 低延迟以太网 10G MAC IP 核发行说明  (HTML | PDF)
  • 1G/10G 和背板以太网 10GBASE-KR PHY 发行说明  (HTML | PDF)
  • 1G/2.5G/5G/10G 多速率以太网 PHY IP 核发行说明  (HTML | PDF)
  • 25G 以太网 IP 核发行说明  (HTML | PDF)
  • 低延迟 40Gbps 以太网 IP 核发行说明  (HTML | PDF)
  • 低延迟 100-Gbps 以太网 IP 核发行说明  (HTML | PDF)
英特尔® Stratix® 10 设备
  • 英特尔® FPGA 三速以太网 IP 核发行说明  (HTML | PDF)
  • 英特尔® FPGA 低延迟以太网 10G MAC IP 核发行说明  (HTML | PDF)
  • 英特尔® Stratix® 10 10G BASE-KR PHY 发行说明  (HTML | PDF)
  • 面向以太网 IP 核的英特尔® Stratix® 10 H-Tile 硬 IP 版本说明  (HTML | PDF)
  • 英特尔® Stratix® 10 低延迟 40-Gbps 以太网 IP 核发行说明 (HTML | PDF)
  • 英特尔® Stratix ®10 低延迟 100-Gbps 以太网 IP 核发行说明  (HTML | PDF)
  • 面向以太网英特尔 FPGA IP 的英特尔® Stratix ®10 E-tile 硬 IP 版本说明(HTML | PDF)
英特尔® Agilex® 设备
  • 面向以太网英特尔 FPGA IP 的英特尔® Agilex® E-tile 硬 IP 版本说明(HTML | PDF)

其他技术