Intel® Stratix® 10逻辑阵列模块和自适应逻辑模块用户指南

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ID 683699
日期 9/21/2018
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1. Intel® Stratix® 10 LAB和ALM概述 2. Intel® Hyperflex™ 寄存器 3. Intel® Stratix® 10 LAB和ALM体系结构和特性 4. Intel® Stratix® 10 LAB和ALM用户指南的文档修订历史
3. Intel® Stratix® 10 LAB和ALM体系结构和特性 x
3.1. LAB 3.2. ALM
3.1. LAB x
3.1.1. MLAB 3.1.2. 本地和直链互联(Local and Direct Link Interconnects) 3.1.3. 进位链互联(Carry Chain Interconnects) 3.1.4. LAB控制信号
3.1.4. LAB控制信号 x
3.1.4.1. 清零逻辑控制(Clear Logic Control)
3.2. ALM x
3.2.1. ALM资源 3.2.2. ALM输出 3.2.3. ALM操作模式
3.2.3. ALM操作模式 x
3.2.3.1. 标准模式 3.2.3.2. 扩展LUT模式 3.2.3.3. 算术模式
3.2.3.3. 算术模式 x
3.2.3.3.1. 进位链(Carry Chain)
1. Intel® Stratix® 10 LAB和ALM概述
2. Intel® Hyperflex™ 寄存器
3. Intel® Stratix® 10 LAB和ALM体系结构和特性
4. Intel® Stratix® 10 LAB和ALM用户指南的文档修订历史

3.2.2. ALM输出

每个ALM中的通用布线输出驱动本地，行和列布线资源。四个ALM输出能驱动行、列或者直链布线连接。

LUT，加法器或者寄存器输出能驱动ALM输出。LUT或者加法器以及ALM寄存器都能够同时从ALM中驱动出。

寄存器封装(Register Packing)通过将无关的寄存器和组合逻辑封装在一个ALM中来提高器件利用率。改善布局布线的另一种机制是支持寄存器输出驱动回相同ALM的LUT中，使寄存器与其本身的扇出LUT封装在一起。ALM也能够驱动寄存的LUT以及未寄存的LUT或者加法器输出。

下图显示了 Intel® Stratix® 10 ALM连接性。在 Intel® Quartus® Prime Resource Property Editor中，整个ALM连接被简化。 Intel® Quartus® Prime软件将对某些布线从内部进行布线。

图 7.  Intel® Stratix® 10 ALM连接详情
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