Intel® Arria® 10收发器PHY用户指南

ID 683617
日期 11/06/2017
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2.4.9.1. 增强型PCS TX和RX控制端口

这一部分描述了不同协议配置的tx_controlrx_control比特编码。

当使能简化的数据接口时,下表中所有未使用的端口都显示为一个单独的端口。例如:显示为unused_tx_control/unused_rx_control端口。

增强型PCS TX控制端口比特编码

表 57.  Interlaken比特编码
名称 比特 功能 说明
tx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[2] 反转控制 逻辑低表明Enhanced PCS中的内置差异生成器模块维持Interlaken运行差异。
[7:3] 未使用  
[8] 插入同步头错误或CRC32 此比特用于插入同步头错误或者CRC32错误。此功能类似于tx_err_ins。关于详细信息,请参考tx_err_ins信号说明。
[17:9] 未使用  
表 58.  10GBASE-R,10GBASE-KR with FEC的比特编码
名称 比特 功能
tx_control [0] parallel_data[7:0]的XGMII控制信号
[1] parallel_data[15:8]的XGMII控制信号
[2] parallel_data[23:16]的XGMII控制信号
[3] parallel_data[31:24]的XGMII控制信号
[4] parallel_data[39:32]的XGMII控制信号
[5] parallel_data[47:40]的XGMII控制信号
[6] parallel_data[55:48]的XGMII控制信号
[7] parallel_data[63:56]的XGMII控制信号
[17:8] 未使用
表 59.  基本单宽度模式的比特编码对于基本单宽度模式,总字长为66比特,包括64比特数据和2比特同步头。
名称 比特 功能 说明
tx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[17:2] 未使用  
表 60.  基本双宽度模式的比特编码对于基本双宽度模式,总字长为66比特,包括128比特数据和4比特同步头。
名称 比特 功能 说明
tx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[8:2] 未使用  
[10:9] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[17:11] 未使用  
表 61.  基本模式的比特编码在此情况下,总字长为67比特,包括64比特数据和2比特同步头。
名称 比特 功能 说明
tx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[2] 反转控制 逻辑低表明Enhanced PCS中的内置差异生成器模块维持运行差异。

增强型PCS RX控制端口比特编码

表 62.  Interlaken的比特编码
名称 比特 功能 说明
rx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[2] 反转控制 逻辑低表明Enhanced PCS中的内置差异生成器模块维持Interlaken运行差异。在当前实现中,此比特始终连接到逻辑低(1'b0)。
[3] 有效负载字对齐 逻辑高(1'b1)指示在元帧中的有效负载字位置。
[4] 同步字位置 逻辑高(1'b1)指示在元帧中的同步字位置。
[5] 加扰器状态字位置 逻辑高(1'b1)指示在元帧中的加扰器字位置。
[6] SKIP字位置 逻辑高(1'b1)指示在元帧中的SKIP字位置。
[7] 诊断字位置 逻辑高(1'b1)指示在元帧中的诊断字位置。
[8] 同步头错误,元帧错误或CRC32错误状态 逻辑高(1'b1)指示同步头错误,元帧错误或CRC32错误状态。
[9] 模块锁定和帧锁定状态 逻辑高(1'b1)表明已经实现模块锁定和帧锁定。
[19:10] 未使用  
表 63.  10GBASE-R,10GBASE-KR with FEC的比特编码
名称 比特 功能
rx_control [0] parallel_data[7:0]的XGMII控制信号
[1] parallel_data[15:8]的XGMII控制信号
[2] parallel_data[23:16]的XGMII控制信号
[3] parallel_data[31:24]的XGMII控制信号
[4] parallel_data[39:32]的XGMII控制信号
[5] parallel_data[47:40]的XGMII控制信号
[6] parallel_data[55:48]的XGMII控制信号
[7] parallel_data[63:56]的XGMII控制信号
[19:8] 未使用
表 64.  基本单宽度模式的比特编码对于基本单宽度模式,总字长为66比特,包括64比特数据和2比特同步头。
名称 比特 功能 说明
rx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[7:2] 未使用  
[9:8] 同步头错误状态 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[19:10] 未使用  
表 65.  基本双宽度模式的比特编码对于基本双宽度模式,总字长为66比特,包括128比特数据和4比特同步头。
名称 比特 功能 说明
rx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[7:2] 未使用  
[8] 同步头错误状态 高电平有效状态信号指示一个同步头错误。
[9] 实现模块锁定 高电平有效状态信号指示模块锁定已经实现。
[11:10] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[17:12] 未使用  
[18] 同步头错误状态 高电平有效状态信号指示一个同步头错误。
[19] 实现模块锁定 高电平有效状态信号指示模块锁定已经实现。
表 66.  基本模式的比特编码在此情况下,总字长为67比特,包括64比特数据和2比特同步头。
名称 比特 功能 说明
rx_control [1:0] 同步头 值为2'b01表明一个数据字。值为2'b10表明一个控制字。
[2] 反转控制 一个逻辑低表明Enhanced PCS中的内置差异生成器模块维持运行差异。