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在器件上电时校准收发器。OSC_CLK_1信号用于器件配置,并且被用于收发器校准逻辑。如果使用了收发器tile,那么OSC_CLK_1必须由自由运行的25 Mhz、100 MHz或125 MHz时钟源来驱动。内部FPGA振荡器不能用于收发器校准。
时钟源在FPGA器件中必须稳定,并且应该在器件操作期间继续运行。